Edgecore AIS800-64D, UfiSpace S9321-64E und S9321-64EO: dasselbe Silizium, dasselbe OcNOS-DC-Image, drei Beschaffungswege. Spezifikationen, Entscheidungsregeln und die OcNOS-DC-Feature-Oberfläche für Ingenieure, die einen Tomahawk-5-Switch auswählen.
Zwei Hardwaredesigns, drei SKUs. Alle drei werden mit vorinstalliertem ONIE ausgeliefert und laufen mit demselben OcNOS-DC-Image. Die Unterschiede liegen im Formfaktor (QSFP-DD vs. OSFP), in der Positionierung (AI-Fabric-SKU vs. allgemeiner DC-SKU) und im Optik-Ökosystem, auf dem der Einsatz aufbaut. Jede Karte verlinkt auf das vollständige Datenblatt des Herstellers (PDF, lokal gehostet).
AI-Fabric für GPU-Cluster. Edgecore-DCS560-Chassis mit dem AI-Fabric-SKU-Framing.
Große, entropiearme AI-Flows. UfiSpace positioniert den 64E für AllReduce-dominierten Verkehr, bei dem das adaptive Routing des TH5 im Zentrum des Designs steht.
800G-ZR/ZR+-Coherent oder andere Modulklassen mit höherer Leistungsaufnahme. OSFP-Formfaktor des 64E: Wählen Sie ihn, wenn die Optik die Cage-Wahl bestimmt.
Der BCM78900 ist ein einzelner monolithischer 5-nm-Die, der 51,2 Tbps Switching-Kapazität liefert und nativ 64 Ports mit 800GbE, 128 mit 400G oder 256 mit 200G speist. Es war Broadcoms erstes 5-nm-Merchant-Switch-IC und das weltweit erste Produkt, das 800GbE am Cage unterstützte. 512 SerDes-Lanes mit 100G PAM4: dieselbe Lane-Anzahl wie Tomahawk 4, die doppelte Geschwindigkeit pro Lane.
Über die reine Kapazität hinaus machten drei architektonische Entscheidungen TH5 zum Silicon unter den meisten produktiven AI-Fabrics: ein Shared-Buffer-Architektur der xCCL-(NCCL / RCCL / oneCCL)-Kollektiv-Microbursts hardwareseitig abfängt Cognitive Routing (DLB), das Elephant Flows im ASIC neu bindet, sowie 5-nm-Thermal-Headroom, der 30-W-QSFP-DD800-Cages ohne aktive Kühlung pro Port betreiben lässt.
Spezifikationen verifizierbar anhand der öffentlichen Broadcom-Angaben BCM78900 Produktseite.
Die Schlagzahl bekommt die Presse. Diese vier technischen Entscheidungen sind das, was AI-Fabric-Architekten tatsächlich interessiert.
TH5 führt dieselben 512 SerDes-Lanes wie TH4 und betreibt sie mit 100G PAM4 statt 50G. Die Verdopplung des Durchsatzes ergab sich durch das Beschleunigen vorhandener Infrastruktur, nicht durch deren Erweiterung.
100G PAM4 · 106 GbpsPaket-Memory-Pools über alle 64 Ports hinweg, nicht pro Port aufgeteilt. xCCL-AllReduce-Micro-Bursts an einem Port werden vom fabric-weiten Pool absorbiert, statt Tail-Drop auszulösen. Der Einzeiler-Grund, warum TH5 bei RoCEv2 gewinnt.
Gemeinsamer Puffer · für RDMA optimiertBroadcom Cognitive Routing erkennt überlastete Pfade und rebindet Elephant Flows im ASIC: kein Controller-Round-Trip, kein ECMP-Rehashing. OcNOS-DC aktiviert dies als DLB Reactive-Path Rebalance.
DLB · 64-µs-FlowletDer erste 5-nm-Merchant-Switch-IC. Erst der Prozess-Shrink machte 30 W pro QSFP-DD800-Cage ohne aktive Kühlung pro Port machbar, einschließlich Hochleistungs-800G-Optik und 8×100G-Breakout.
TSMC N5 · 30 W/PortTH4 (25.6 Tbps · 64×400G · 7 nm) ist für Cluster rund um 400G-NICs weiterhin hervorragend. TH5 rechtfertigt seinen Platz im Rack, wenn sowohl 800G pro Port als auch AI-Fabric-Primitive zählen.
Verdoppelt bei gleichbleibendem Rack-Footprint. Gleiche 2RU, gleiche Leistungsklasse.
Dieselbe 64-Port-Radix auf den tatsächlichen IPI-Plattformen (AS9736-64D → AIS800-64D / S9321). Die Bandbreite pro Port verdoppelt sich, sodass jede Clos-Stufe doppelt so viel Traffic transportiert.
Erster 5-nm-Merchant-Switch-IC. Thermische Reserve für 30 W/Port ohne aktive Kühlung.
Dieselben 512 Lanes, doppelte Geschwindigkeit. Die Durchsatzverdopplung kam aus der bestehenden Infrastruktur.
Tomahawk 5 hat die Hardware. Die Aufgabe des NOS ist es, sie zugänglich zu machen: für Operatoren, für Telemetrie-Pipelines, für den Cluster-Scheduler, ohne sie zu CLI-Verrenkungen drumherum zu zwingen. OcNOS-DC liefert diese Primitive als erstklassige konfigurierbare Objekte mit YANG-modelliertem State.
OcNOS-DC liefert PFC + ETS + Dynamic ECN bereits auf xCCL-Kollektiv-Pattern abgestimmt aus. Die Tail-Latenz bleibt auch unter AllReduce-Micro-Bursts begrenzt, die Community-NOS-Fabrics in die Knie zwingen. Der Shared-Buffer-Pool des TH5 absorbiert synchronisierten Many-to-One-Traffic, der auf Chips mit partitionierten Buffern zu Tail-Drops führen würde.
ECMP-Hash-Kollisionen unter Elephant Flows sind der AI-Fabric-Killer. OcNOS-DC aktiviert das Flowlet-Rebinding von TH5 Cognitive Routing, sodass sich AllReduce-Verkehr automatisch über jeden Spine-Pfad verteilt.
Erkennt Paused-Queue-Zyklen, bevor sie Training-Jobs zum Stillstand bringen. Automatische Wiederherstellung ohne Eingriff des Betreibers.
Buffer-Tiefe, ECN-Marks, PFC-Pause-Zähler: jeder Schwellenwert ein Stellrad, jeder Counter ein Sensor-Pfad. Bindet sich in Prometheus, Grafana und OTel ein.
Der TH5-Spine ist außerdem ein echter Router. Vollständiger Carrier-Grade-Layer-3-Stack auf demselben Silicon: Betreiben Sie das AI-Fabric wie den Rest Ihres Netzwerks, nicht wie eine Black Box.
Layer-3-Routing · L1/L2 · AI-Fabric-Grundfunktionen · Multicast · QoS · Sicherheit · Hardware · Management. Jeder Eintrag ist pro Plattform in der öffentlichen Matrix überprüfbar.
Bringen Sie einen TH5-Spine im Rack per Zero-Touch-Provisioning hoch. Streamen Sie jeden Counter in Ihren Observability-Stack. Justieren Sie jeden Schwellenwert über YANG-modellierte Config. Keine Glue-Skripte.
Derselbe TH5-Die, dasselbe OcNOS-DC-Image, drei verschiedene Rahmungen derselben architektonischen Frage: Wie skalieren Sie Lossless-East-West, ohne den gesamten Stack an einen einzigen Anbieter zu binden?
"Wir brauchen 800G zum Leaf, verlustfreies RoCEv2 und eine Tail-Latency, die unter AllReduce nicht explodiert. Single-Vendor-Lock-in kommt nicht infrage."
TH5-64×800G-Spines, RoCEv2 mit xCCL-getuntem DCQCN, DLB-Rebinding im Submillisekundenbereich, PFC-Deadlock-Watchdog. Gleiche 64-Port-Radix wie TH4, aber jeder Spine-Port trägt 800G, was die Spine-Leaf-Verkabelung bei gleicher aggregierter Fabric-Bandbreite halbiert.
DC · AI-Fabric-SKUAI-Cluster-Operator
"Unsere Kunden wählen die GPU. Wir können unsere Fabric-BoM nicht an deren NIC-Wahl koppeln. Wir brauchen einen Switch, den wir von mindestens zwei Herstellern beziehen können."
Drei OcNOS-validierte TH5-SKUs von zwei Herstellern (Edgecore, UfiSpace). Tenant-Isolation mit VRF-Lite, gNMI-Telemetrie pro Tenant, EVPN-VXLAN-Segmentierung. Ein NOS-Image, Multi-Vendor-Hardware.
DC · MandantenfähigNeoCloud · GPU-as-a-Service
"Wir haben eine TH4-Fabric in Produktion. Der nächste Training-Cluster braucht 800G-NICs. Wir wollen nicht die gesamte NOS-Schicht neu entwerfen, um das Silicon aufzurüsten."
Dasselbe OcNOS-DC-Image läuft auf TH3-, TH4- und TH5-Plattformen. Ein Brownfield-Refresh hält Konfigurationen, Automatisierung und gNMI-Pipelines intakt.
DC · TH3 bis TH5Hyperscaler · Brownfield-Refresh
30-minütige Architektursitzung mit einem OcNOS-Netzwerkarchitekten. Bringen Sie Ihre GPU-Anzahl, NIC-Geschwindigkeit und bevorzugte Ebenenstruktur mit und erhalten Sie eine dimensionierte Stückliste für alle drei TH5-SKUs.
Das Produktdatenblatt und kurze, technische Downloads, die über diese Seite hinausgehen.
Vollständige OcNOS-DC-Spezifikation: Funktionsumfang für EVPN-VXLAN und Ethernet for AI, Software-SKUs, unterstützte Hardware-Plattformen und der Solution Ordering Guide.
Datenblatt abrufenNon-Blocking-RoCEv2-Fabric auf Broadcom-Tomahawk-4/5-Spines: SKU-Stufen, validierte Plattformen und Deployment-Architektur.
Brief anfordernCarrier-Grade-Leaf-Spine-Data-Center-Fabric: symmetrisches IRB, Type-2/Type-5-Routen und verteiltes Anycast-Gateway.
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Mit Julian Sierra Garcia, Fernando Silva, Miguel Alonso